asic 制造 文章 進入asic 制造技術社區(qū)
NVIDIA已開始關注"定制芯片"制造 招募臺灣頂尖人才
- 據(jù)報道，英偉達（NVIDIA）已開始關注"定制芯片"制造，該公司招募了數(shù)名臺灣工程師，通過新建的臺灣研發(fā)中心實施 ASIC 制造，促進本地人才的發(fā)展，并開拓這一細分市場。英偉達（NVIDIA）致力于開發(fā)定制芯片（ASIC）的消息一直不絕于耳，這主要是因為多家科技公司都希望擁有自己的人工智能算力儲備，并根據(jù)自身需求量身定制。 目前，NVIDIA 開發(fā)的是開放架構的人工智能產(chǎn)品，如 Blackwell 和 Hopper 系列，但在為客戶打造定制化解決方案方面，該公司仍在不斷追求。
- 關鍵字： NVIDIA 定制芯片 ASIC 制造 人工智能
實際案例說明用基于FPGA的原型來測試、驗證和確認IP——如何做到魚與熊掌兼得？
- 本系列文章從數(shù)字芯片設計項目技術總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設計和驗證規(guī)劃進行結合，詳細講述了在FPGA上使用硅知識產(chǎn)權（IP）內(nèi)核來開發(fā)ASIC原型項目時，必須認真考慮的一些問題。全文從介紹使用IP核這種預先定制功能電路的必要性開始，通過闡述開發(fā)ASIC原型設計時需要考慮到的IP核相關因素，用八個重要主題詳細分享了利用ASIC IP來在FPGA上開發(fā)原型驗證系統(tǒng)設計時需要考量的因素。同時還提供了實際案例來對這些話題進行詳細分析。這八個主題包括：一款原型和最終ASIC實現(xiàn)之間的要求有何不同
- 關鍵字： 202411 FPGA FPGA原型 確認IP ASIC SmartDV
將ASIC IP核移植到FPGA上——如何測試IP核的功能和考慮純電路以外的其他因素
- 本系列文章從數(shù)字芯片設計項目技術總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設計和驗證規(guī)劃進行結合，詳細講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時，必須認真考慮的一些問題。文章從介紹使用預先定制功能即IP核的必要性開始，通過闡述開發(fā)ASIC原型設計時需要考慮到的IP 核相關因素，用八個重要主題詳細分享了利用ASIC IP來在FPGA上開發(fā)原型驗證系統(tǒng)設計時需要考量的因素。在上篇文章中，我們分享了第五到第六主題，介紹了我們?nèi)绾未_保在FPGA上實現(xiàn)所需的性能和在時鐘方面必須加以考量的因素有哪些。本篇
- 關鍵字： 202409 ASIC IP核 FPGA SmartDV
將ASIC IP核移植到FPGA上——如何確保性能與時序以完成充滿挑戰(zhàn)的任務！
- 本系列文章從數(shù)字芯片設計項目技術總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設計和驗證規(guī)劃進行結合，詳細講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時，必須認真考慮的一些問題。文章從介紹使用預先定制功能即IP核的必要性開始，通過闡述開發(fā)ASIC原型設計時需要考慮到的IP核相關因素，用八個重要主題詳細分享了利用ASIC IP來在FPGA上開發(fā)原型驗證系統(tǒng)設計時需要考量的因素。在上篇文章中，我們分享了第二到第四主題，介紹了使用FPGA進行原型設計時需要立即想到哪些基本概念、在將專為ASIC技術而設計的I
- 關鍵字： ASIC IP FPGA SmartDV
將ASIC IP核移植到FPGA上——更新概念并推動改變以完成充滿挑戰(zhàn)的任務!
- 本系列文章從數(shù)字芯片設計項目技術總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設計和驗證規(guī)劃進行結合，詳細講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時，必須認真考慮的一些問題。文章從介紹使用預先定制功能即IP核的必要性開始，通過闡述開發(fā)ASIC原型設計時需要考慮到的IP核相關因素，用八個重要主題詳細分享了利用ASIC所用IP來在FPGA上開發(fā)原型驗證系統(tǒng)設計時需要考量的因素。在上篇文章中，我們介紹了將ASIC IP移植到FPGA原型平臺上的必要性，并對原型設計中各種考量因素進行了總體概述，分析開發(fā)A
- 關鍵字： ASIC IP FPGA SmartDV
非英偉達聯(lián)盟崛起 ASIC廠吃香
- 英偉達（NVIDIA）恐受到法國反壟斷監(jiān)管機關的指控，「非英偉達陣營」同唱凱歌，UALink（Ultra Accelerator Link）聯(lián)盟及UXL基金會兩大陣營反撲，將大幅提升專用ASIC開發(fā)力度，相關硅智財可望獲得多方采用。法人指出，臺廠受惠晶圓代工領導地位，ASIC、IP布局完整，搶搭非輝聯(lián)盟崛起列車。 半導體業(yè)者表示，ASIC大廠創(chuàng)意、智原、巨有科技，硅智財M31、力旺，及神盾集團積極布局該領域。神盾年初以約當47億元價值并購新創(chuàng)IP公司干瞻，旗下安國、芯鼎也同步搶進ASIC市場。GPU在AI
- 關鍵字： 英偉達 ASIC GPU AI模型訓練
IC設計倚重IP、ASIC趨勢成形
- 半導體制程進入2奈米，擷發(fā)科技董事長楊健盟指出，IC設計難度陡增，未來硅智財、ASIC角色將更加吃重，協(xié)助IC設計以SoC方式因應AI新世代。楊健盟分析，過往IDM分拆晶圓代工之典范，將在IC設計上發(fā)生，AI時代IC設計大者恒大趨勢成形。 擷發(fā)科技已獲國際芯片大廠AI芯片外包訂單，楊健盟認為，現(xiàn)在芯片晶體管動輒百億個，考驗IC設計業(yè)者研發(fā)量能。大量采用基礎、接口IP使研發(fā)能力更能專注前段設計，海外大廠甚至將后段交由ASIC業(yè)者，未來倚重IP、ASIC趨勢只會更加明顯。中國臺灣半導體產(chǎn)業(yè)鏈在邏輯先進制程、先
- 關鍵字： IC設計 IP ASIC
ASIC紛擾 創(chuàng)意4月營收看淡
- ASIC廠商創(chuàng)意公布4月合并營收16.93億元、寫近期低點。ASIC族群乏力，世芯-KY法說后亦遭逢市場賣壓調(diào)節(jié)，法人認為，主要是產(chǎn)品進入世代遷移、營運預期相對保守；創(chuàng)意則可能是項目營收遞延認列，據(jù)公司指引，第二季季增介于15～20％，可觀察接續(xù)兩個月情況。目前ASIC仍為寡占市場，后進者來勢洶洶，競爭同業(yè)也積極爭取CSP項目，短期仍有市場紛擾。創(chuàng)意4月合并營收月減22.75％，年減15.93％；累計前四月合并營收73.83億元，年減13.57％。公司預估，本季度NRE（委托設計）、Turnkey（量產(chǎn)）
- 關鍵字： ASIC 創(chuàng)意
星云智聯(lián)首款自研DPU ASIC芯片一版流片成功
- 近日，星云智聯(lián)自主研發(fā)的DPU芯片M18120回片后，十分鐘內(nèi)成功點亮，十八小時完成通流驗證，成功實現(xiàn)了芯片設計目標！這一優(yōu)異的成績得益于星云智聯(lián)規(guī)范的IPD產(chǎn)品流程、嚴格的質(zhì)量控制、高效的項目管理，以及全體星云人的不懈努力。M18120是星云智聯(lián)推出的首款DPU ASIC芯片，集成了公司自主研發(fā)的網(wǎng)絡、存儲、安全、RDMA、可編程轉發(fā)等核心技術，最大吞吐性能達到200Gbps，能夠滿足公有云、混合云、私有云、NVMe存儲、網(wǎng)絡安全和工業(yè)控制等各種應用場景的需求。在AI大模型時代，DPU作為智算網(wǎng)絡發(fā)展的
- 關鍵字： 星云智聯(lián) DPU ASIC
ASIC迎爆發(fā) 臺積電助力IP授權企業(yè)鍍金
- 人工智能、機器學習等應用帶動，ASIC（特殊應用芯片）成為下一個階段半導體成長動能。雖然目前CSP業(yè)者仍以GPU為首選，然各家大廠相繼推出自家ASIC，因應訓練需求，并導入推論應用。臺積電將是AI浪潮中最受惠企業(yè)，同時帶領中國臺灣股市中的IP大聯(lián)盟共啖大餅，創(chuàng)意、世芯-KY、力旺已擠進千金（股價破千）行列，M31近日站上900元大關，有望接棒續(xù)強，扮演畫龍點睛之效。英偉達GPU通用性高，除高算力芯片之外，也提供完整生態(tài)系之護城河，如CUDA內(nèi)含一系列程序設計工具、鏈接庫及框架。然GPU售價高昂，且未提供客
- 關鍵字： ASIC 臺積電 IP授權
我國研制出首顆支持片上學習憶阻器存算一體芯片
- 近期，清華大學集成電路學院團隊研制出全球首顆全系統(tǒng)集成的、支持高效片上學習的憶阻器存算一體芯片。據(jù)清華大學官微消息，近期，清華大學集成電路學院教授吳華強、副教授高濱團隊基于存算一體計算范式，研制出全球首顆全系統(tǒng)集成的、支持高效片上學習的憶阻器存算一體芯片，在支持片上學習的憶阻器存算一體芯片領域取得重大突破，有望促進人工智能、自動駕駛可穿戴設備等領域發(fā)展。相關成果發(fā)表于最新一期的《科學》（Science）。相同任務下，該芯片實現(xiàn)片上學習的能耗僅為先進工藝下專用集成電路（ASIC）系統(tǒng)的1/35，同時有望實現(xiàn)
- 關鍵字： 清華大學 ASIC 存算一體
針對噪聲模擬設計的 ASIC 修復
- 噪聲是混合信號 ASIC 中的一個常見問題，會降低性能并危及產(chǎn)品的完成度。本應用筆記提供了添加外部電路的提示和技巧，使許多 ASIC 可用于原型設計或作為終產(chǎn)品進行交付。討論了通過校正模擬電路中的噪聲、進行調(diào)整、校準增益和偏移以及清潔電源來優(yōu)化 ASIC 的方法。其回報是更快的上市時間，甚至可以防止額外的 ASIC 制造旋轉。噪聲是混合信號 ASIC 中的一個常見問題，會降低性能并危及產(chǎn)品的完成度。本應用筆記提供了添加外部電路的提示和技巧，使許多 ASIC 可用于原型設計或作為終產(chǎn)品進行交付。討論了通過校
- 關鍵字： ASIC
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